Método de laminación para el estudio de las interfaces en transistores poliméricos de película delgada

Michael L Chabinyc1, Alberto Salleo, Yiliang Wu

  • 1Palo Alto Research Center, 3333 Coyote Hill Road, Palo Alto, California 94304, USA. mchabinyc@parc.com

Resumen

Un nuevo método de laminación permite la fabricación de transistores de película delgada de polímero (TFT). Esta técnica mejora el rendimiento del semiconductor de polímero, lo que sugiere que el ordenamiento molecular, no la electrónica de interfaz, dicta la movilidad TFT.

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